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[(ÁÖ)¿¢½ºÆÛ³Ý] IT±â¼ú¿µ¾÷ ½ÅÀÔ»ç¿ø °ø°³Ã¤¿ë(~03/05)D-8
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[(ÁÖ)¿¢½ºÆÛ³Ý] IT±â¼ú¿µ¾÷ °æ·Â»ç¿ø °ø°³Ã¤¿ë(~03/05)D-8
Á¤±ÔÁ÷ | ¼¿ï>±¸·Î±¸ | ´ëÇÐ(2,3³â)Á¹¾÷ÀÌ»ó | °æ·Â(¿¬Â÷¹«°ü) | ¿¬ºÀ ȸ»ç³»±Ô
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[¿¢½ºÆÛ³Ý] µå·Ð Çϵå¿þ¾î / Æß¿þ¾î °³¹ß ½Å±Ô/°æ·ÂÁ÷ ä¿ë(~03/05)D-8
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[¿¢½ºÆÛ³Ý] µå·Ð ¼ÒÇÁÆ®¿þ¾î / Æß¿þ¾î °³¹ß ½Å±Ô/°æ·ÂÁ÷ ä¿ë(~03/05)D-8
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[¿¢½ºÆÛ³Ý] IT±â¼úº»ºÎ(NAC) ¿£Áö´Ï¾î °æ·ÂÁ÷ °ø°³Ã¤¿ë(~03/05)D-8
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[(ÁÖ)¿¢½ºÆÛ³Ý] IT±â¼úÁö¿ø(NAC) ½ÅÀÔ»ç¿ø °ø°³Ã¤¿ë(~03/05)D-8
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[(ÁÖ)¿¢½ºÆÛ³Ý] IT±â¼úÁö¿ø(±¤Àü¼Û) ½ÅÀÔ»ç¿ø °ø°³Ã¤¿ë(~03/05)D-8
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[(ÁÖ)¿¢½ºÆÛ³Ý] IT±â¼úÁö¿ø(±¤Àü¼Û) °æ·ÂÁ÷ °ø°³Ã¤¿ë(~03/05)D-8
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[(ÁÖ)¸¶ÀÌÅ©·Î¿£¿¢½º ±¸Áö°øÀå »ý»êº»ºÎ °¡°øÆÄÆ®] CNC ..(ä¿ë½Ã)
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Software Architecture ¼³°è ¿£Áö´Ï¾î(»ó½Ã)
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Design Verification ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ¾î ÇÁ..(»ó½Ã)
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DDR DRAM Controller ¼³°è ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ..(»ó½Ã)
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FPGA Ç÷§Æû ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ¾î ÇÁ·Î¼¼¼ °³¹ß)(»ó½Ã)
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PCIe Digital ¼³°è ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ¾î ÇÁ·Î¼¼¼ ..(»ó½Ã)
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SoC ASIC ¼³°è ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ¾î ÇÁ·Î¼¼¼ °³¹ß)(»ó½Ã)
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High Level Synthesis (HLS) ¼³°è ¿£Áö´Ï¾î (..(»ó½Ã)
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System SW ¿£Áö´Ï¾î(»ó½Ã)
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RTL ±â¹Ý HW IP ¼³°è ¿£Áö´Ï¾î (µö·¯´× Çϵå¿þ¾î ÇÁ·Î¼¼¼ ..(»ó½Ã)
Á¤±ÔÁ÷ | °æ±â>¼º³²½Ã ºÐ´ç±¸ | ´ëÇб³(4³â)Á¹¾÷ÀÌ»ó | ½ÅÀÔ/°æ·Â(¿¬Â÷¹«°ü) | ¿¬ºÀ 4,000~10,000¸¸¿ø
À¯¿¢½ºÆÑÅ丮
¼ÒÇÁÆ®¿þ¾î, Çϵå¿þ¾î ¿Ü ½ÅÀÔ/°æ·Â Á¤±ÔÁ÷ ä¿ë(»ó½Ã)
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Á¤±ÔÁ÷ | °æ±â>¼º³²½Ã ºÐ´ç±¸ | ´ëÇб³(4³â)Á¹¾÷ÀÌ»ó | °æ·Â5³âÀÌ»ó | ¿¬ºÀ 4,000~10,000¸¸¿ø
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Àü¹®¿¬±¸¿ä¿ø (º´¿ªÆ¯·Ê) ¼ö½Ã¸ðÁý (AI / SW ºÐ¾ß)(»ó½Ã)
º´¿ªÆ¯·Ê | °æ±â>¼º³²½Ã ºÐ´ç±¸ | ¼®»çÁ¹¾÷ÀÌ»ó | ½ÅÀÔ/°æ·Â(¿¬Â÷¹«°ü) | ¿¬ºÀ 4,000~10,000¸¸¿ø
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°æ¸®, ±Þ¿©°ü¸® ¿Ü °æ·Â Á¤±ÔÁ÷ ä¿ë(ä¿ë½Ã)
Á¤±ÔÁ÷ | ¼¿ï>°³²±¸ | ´ëÇб³(4³â)Á¹¾÷ | °æ·Â8³âÀÌ»ó | ¿¬ºÀ 3,500~4,000¸¸¿ø
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3D CAD¸ðµ¨¸µ, ±ÝÇü¼³°è °æ·ÂÀÚ ¸ðÁý(ÀÚµ¿Â÷½ÃÆ® ÁÖ¹°±Ý..(~03/24)D-27
Á¤±ÔÁ÷ | °æ±â>½ÃÈï½Ã | Çз¹«°ü | °æ·Â1³âÀÌ»ó | ¿¬ºÀ 2,500~5,000¸¸¿ø
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